AES/EBU: frame structure

Published On Oct-05-2017

Transcripción

Consideremos ahora un segundo aspecto fundamental del estándara AES/EBU, la manera en la que los paquetes de información están organizados, es decir, su frame structure.

La cadena de bits se organiza en subframes de 32 bits cada uno. Recordemos que dos canales distintos viajan a través del mismo conductor. Para lograrlo, se alternan los subframes de cada canal, por medio de time-division. Los primeros cuatro bits de cada subframe, del 0 al 3, se utilizan como patrón de sincronización. En la figura, se identifican como preámbulo o preamble. Al preámbulo le siguen los 24 bits correspondientes a la magnitud de la muestra de audio. En caso de que solo 20 bits sean utilizados, los bits del 4 al 7 pasan a ser bits auxiliares de información. En transmisiones de 16 bits, el mensaje se transmite entre los bits 12 y 27. Nótese que el bit menos significativo se transmite primero, de manera que el MSB siempre se ubique en la posición 27. Los bits que no se utilicen se rellenan con ceros hasta alcanzar un wordlength de 20 bits.

Figura 12.8. Organización de los bits en el estándar AES/EBU

Algunas versiones anteriores de la interfaz AES/EBU transmitían el MSB primero, al menos en la transmisión de información de un chip a otro dentro del mismo dispositivo. La razón es que este era el orden en el que se obtenían los bits en los convertidores de aproximación sucesiva. Sin embargo, la ventaja principal de transmitir primero el LSB, es que se simplifican las operaciones aritméticas. Hoy en día, los dispositivos se diseñan de manera que las conexiones de entrada y salida provean el mismo orden, primero el LSB, de manera que se evite la necesidad de adaptadores que inviertan el orden de los bits pertenecientes al word, es decir, a la magnitud de la muestra de audio.

Es importante mencionar que el estándar AES/EBU también especifica que el código binario utilizado debe ser con complemento a dos.

Al final del subframe se incluyen 4 bits de estado o status bits. El bit “validity flag” se reinicia si la muestra correspondiente es confiable. Según la revisión AES-3-1992, este bit se encarga de indicar que la información del subframe es “apropiada para la conversión a una señal analógica”.

El bit de paridad o parity bit alterna entre 1 y 0, de manera que la cantidad de unos en el subframe sea par. De esta manera, se logra que los patrones de sincronización sucesivos tengan la misma polaridad. Esto, a su vez, aumenta la probabilidad de una sincronización apropiada.

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